采用CPLD器件实现PXI触发总线接口的设计方案

采用CPLD器件实现PXI触发总线接口的设计方案

LinkedIn引言

pxi触发总线规范

推荐1：接受或者发送触发信号的模块应该跟系统中别的7个模块互连，任何一个模块都可以作为触发信号的发送或者接受端。

推荐4：触发总线上的电平有可能是中间电平（vol

pxi触发接口实现原理图

这里只给出一路触发总线实现的原理图，由于8路触发总线之间是独立工作的，因此，每一路都可以用同样的原理来实现，只是实际应用中，8路信号可以共用一些控制线而已。一路触发总线接口的原理如图1所示。

图1中，由t1、t2、n3和n4构成输入/输出控制部分，当ioc＝1时，t1导通，t2截止，接口工作在输入状态，由别的模块送来的触发信号送入施密特触发器进行触发；当ioc＝0时，t1截止，t2导通，接口工作在输出状态，触发信号通过本接口输出送到别的模块进行触发同步。

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