基于FPGA的高速通信系统研究

基于FPGA的高速通信系统研究

引言

1 系统构成及原理

高速数据传输系统的原理框图如图1所示。整个系统由发送板、接收板和传输线三部分组成。

系统的输入信号包括串口信号、网络信号和并行视频信号等。分别选用MAX232，RTL8201，SN74LVC4245等芯片组成接口电路，将输入信号转换为FPGA支持的LVTTL／LVCMOS电平信号，起到保护器件和增加信号驱动能力的作用。

接收板FPGA首先完成系统输入信号的接收工作，再将异步时钟域的信号转换到统一的系统时钟下，接下来将信号并串转换并添加起始位、停止位和校验位组成特定的帧格式，然后对其进行8 B／10 B编码，最后通过差分I／O以LVDS电平输出。接收板FPGA接收到串行信号后将信号解码、解帧，抽取出原始数据进行恢复，最后通过相应的I／O将恢复后的信号输出给各接口。

从FPGA直接输出的LVDS信号在100 Mb／s传输速率下传输距离不足10 m，需要使用电缆驱动电路增加LVDS信号的驱动能力，同时使用接收均衡电路补偿通过电缆传输后衰减的信号，达到加强系统长距离传送能力的目的。

2 系统的硬件设计

2．1 FPGA部分电路设计

版权声明：本文内容由网络用户投稿，版权归原作者所有，本站不拥有其著作权，亦不承担相应法律责任。如果您发现本站中有涉嫌抄袭或描述失实的内容，请联系我们jiasou666@gmail.com 处理，核实后本网站将在24小时内删除侵权内容。