基于FPGA和MV-D1024E相机的图像采集系统

基于FPGA和MV-D1024E相机的图像采集系统

1 引言

2 图像采集系统结构框图

图像采集系统由CAMERA-LINK接口、USB通信接口控制、相机控制及相机数据缓冲存储控制等模块组成，其系统框图如图1所示。

3 图像采集系统的设计

3．1 EP1C6Q240C8简介

FPGA主器件是Ahera公司Cvclone系列的EPlC6Q240C8，具有5 980个逻辑单元和120 000个典型门资源和185个可编程I／O端口，最高工作时钟可到300MHz以上，核心供电电压1．5 V，I／O缓冲供电电压3．3 v，通过JTAG接口实现系统配置。使用的配置器件EPC4串行ROM容量约为4 Mbit，可重复编程50次左右，JTAG接口符合IEEE Std．1149．1标准。

3．2 MV-D1024E相机及CAMERA-LINK接口简介

3．3 相机接口及控制模块设计

MV-D1024E系列相机具有12 bit的数据输出，附加相机的时钟PCLK、帧频信号FVAL、行频信号LVAL和数据有效信号DVAL。图3为用FPGA设计生成的相机接口模块，该模块完成相机数据及各时钟信号的接入，并集成串行接口模块，将用户对相机的控制信号发送到相机。完成相机的参数设置功能。

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