用FIFO设计A/D与DSP之间的接口

用FIFO设计A/D与DSP之间的接口

１　前言

２．１ ＦＩＦＯ读写过程

２．２ ＤＳＰ的读时序设计

(１)ＳＥＴＵＰ≥１；

(２)ＳＴＲＯＢＥ≥?ｔａｃｃ＋ｔｓｕ）ＥＣＬＫ；

(３)ＳＴＯＢＥ≥ｔｒｐ ＥＣＬＫ;

(４)ＳＥＴＵＰ＋ＳＴＲＯＢＥ＋ＨＯＬＤ≥ｔｒｃ ＥＣＬＫ;

２．３ 软件设计

图３所示是该系统中ＤＳＰ的软件流程图。由于ＴＭＳ３２０Ｃ６２１１采用ＲＯＭ加载的芯片自举模式，因此，在芯片复位过程中，ＥＤＭＡ将从位于外部ＣＥ１空间的ＥＥＰＲＯＭ中拷贝１ｋＢ数据到地址０处，并在传输结束后，使ＣＰＵ退出复位状态，同时从地址０处开始执行指令。由于主程序大小要大于１ｋＢ，所以需要编写ＢＯＯＴ ＬＯＡＤ（大小小于１ｋＢ）程序，以使其在复位后将程序从外部ＥＥＰＲＯＭ拷贝到内部程序ＲＡＭ中运行。在图３所示的主程序流程图中，当系统上电复位后，首先应进行ＤＳＰ的初始化，接着进行ＥＤＭＡ的中断使能和初始化，然后由ＦＩＦＯ的半满信号启动ＥＤＭＡ传输和由其触发中断程序。当传输完一组２０４８个数据后，再根据重心算法求出ＣＣＤ像点的位置，之后便可开始下一次循环。３　结束语

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